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抗差分功耗分析和差分故障分析的AES算法VLSI设计与实现
抗差分功耗分析 差分故障分析 AES算法 VLSI设计
2009/8/28
提出了一种抗差分功耗分析和差分故障分析的AES算法硬件设计与实现方案，该设计主要采用了数据屏蔽和二维奇偶校验方法相结合的防御措施。在保证硬件安全性的前提下，采用将128位运算分成4次32位运算、模块复用、优化运算次序等方法降低了硬件实现成本，同时使用3级流水线结构提高了硬件实现的速度和吞吐率。基于以上技术设计的AES IP核不仅具有抗双重旁道攻击的能力，而且拥有合理的硬件成本和运算性能。
数字电视标准DMB-T高速LDPC译码器VLSI设计
数字电视广播地面传输标准 修正最小和算法 半并行译码器
2009/7/10
在我国的数字电视广播地面传输标准DMB-T中，使用了准循环非规则LDPC码作为前向纠错编码。针对此标准中LDPC码的特点，采用修正最小和译码算法，设计了一种半并行结构实时译码器，可实现DMB-T中三种不同码率下的LDPC译码，并有效地实现了硬件结构复用。与其他设计方案相比较，减少了RAM块的数量一半以上，全局布线难度也大大降低。整个设计在Stratix II FPGA上进行了综合验证。当译码迭代次...