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高速SDRAM控制器设计的FPGA实现
现场可编程门阵列 高速状态机 SDRAM控制器 状态机分解
2008/3/4
同步动态存储器(SDRAM)控制器通常用有限状态机实现，对于一般的设计方法，由于状态数量多，状态转换通常伴随大的组合逻辑而影响运行速度，因此，SDRAM控制器的速度限制了SDRAM存储器的访问速度。该文从结构优化入手来优化方法，利用状态机分解的思想将大型SDRAM控制状态机用若干小的子状态机实现，达到简化逻辑的目的，不仅提高了速度还节省了资源，对该类大型SDRAM控制器的实现有一定参考意义。
为提高线阵CCD边缘检测系统的精度、速度、集成度,以及系统的可靠性,提出一种集成于单片FPGA、全数字化的亚像元边缘检测系统.根据图像边缘灰度梯度的阶跃特性,通过边缘自动检测算法确定出经过高斯滤波处理的CCD图像的像元级边界,在此基础上应用多项式插值算法对图像边缘位置进行亚像元细分,实现亚像元边缘检测.以FPGA作为系统的处理核心及数字电路硬件载体,利用VHDL语言以及MAX＋plus Ⅱ软件对系...