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数字电视标准DMB-T高速LDPC译码器VLSI设计
数字电视广播地面传输标准 修正最小和算法 半并行译码器
2009/7/10
在我国的数字电视广播地面传输标准DMB-T中，使用了准循环非规则LDPC码作为前向纠错编码。针对此标准中LDPC码的特点，采用修正最小和译码算法，设计了一种半并行结构实时译码器，可实现DMB-T中三种不同码率下的LDPC译码，并有效地实现了硬件结构复用。与其他设计方案相比较，减少了RAM块的数量一半以上，全局布线难度也大大降低。整个设计在Stratix II FPGA上进行了综合验证。当译码迭代次...
VLSI冗余单元最优分配的遗传算法求解
遗传算法 成品率 备用单元
2009/5/8
随着VLSI芯片面积的增加和电路复杂性的增强,芯片的成品率受制造缺陷影响的概率逐渐增加。为了解决这一问题,人们将容错技术结合入集成电路设计中。要使一个系统具有较强的容错能力,必须给系统提供一定量冗余单元。本文利用遗传算法有效地解决了使系统成品率达到最大的冗余单元最优分配问题。
An Efficient VLSI Architecture of VLD for AVS HDTV Decoder
VLSI Architecture VLD AVS HDTV Decoder
2006/12/31
!aIn this paper, we present a VLSI design of Variable Length Code Decoder for AVS video standard. As a co-processor of a RISC CPU, the design can decode Fixed Length Code, unsigned or signed k-th Exp-...
An Efficient VLSI Architecture of the Sample Interpolation for MPEG-4 Advanced Simple Profile
Efficient VLSI Architecture the Sample Interpolation MPEG-4 Advanced Simple Profile
2004/12/31
Sample interpolation which has a computationally expensive finite impulse response (FIR) digital filter is one of the key modules in MPEG-4 Advanced Simple Profile (ASP). Normal FIR architectures have...